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标题:
PCI&LVDS产品开发平台(RPDP-PCI&LVDS)
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作者:
dz51demo
时间:
10.11.2007 09:12
标题:
PCI&LVDS产品开发平台(RPDP-PCI&LVDS)
【产品价格】
+ L) _! j) i' z1 I! [
标准版: ￥2500
1 [) I; O% X/ \! B
$ m- f7 R, S- K% c5 l- `# j% j) M" B
【产品定位】
/ |% |9 V: t8 P* J' F# f5 q
基于PCI的高速数据采集卡开发
, |+ }' @: r( w. A/ o
基于LVDS接口的高速数据采集处理卡；
2 d" h8 j+ Q- E7 O- M9 i1 W
算法加速卡;
2 M3 I5 L6 G- R5 d; R- a( O
" l% V( c( H8 u# `3 \+ p' R
+ K6 O4 K9 s) X0 q+ Z/ e$ K4 ]- X
【产品特色】
j+ _# I) G6 V) I3 D) C* T& n
提供完整的FPGA+PCI解决方案，性能稳定,兼容性好；
+ K4 V2 [5 e8 q4 q
提供完整的参考设计,包括FPGA代码,驱动程序,应用程序等,可以作为项目开发的模板;
! b: C- I2 @ V7 ]6 `" Q
扩展性能好，可以扩展音频输入输出卡，视频输入输出卡，高速AD，DA等。
$ N! T% ]1 D: q# r
/ X& Y1 P( v) F4 {; m
6 l6 O& E. X( A* \/ x- X, R
【产品清单】
$ V: s$ C; n y3 M: v1 r- b% V* J7 c
1、RPDP-PCI&LVDS开发板 1块
1 w$ H5 x- P4 y) _6 F
2、ByteBlasterII 下载电缆 1条
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3、配套DVD光盘 1张
* ?. t/ `5 y% T( U* R
& x: B' t1 K- y+ }- O5 {
! Z. s# t6 m2 h2 j
【硬件资源】
; Y. P$ s% J' K: m% j! v2 b, a
1、FPGA芯片：
" `3 C' m3 K/ i, E9 _: G
标准版：EP1C6Q240， 包括12,060LEs，相当于15万门左右
9 g# C8 r4 c$ ` S# L
增强版：EP1C12Q240，包括12,060LEs，相当于30万门左右
$ s* D- f' G9 F' e, i# K9 R
2、配置芯片：
" \; |$ x( H- z2 T7 U: C8 ?
增强版：EPCS1，1Mbit储存量，支持AS和JTAG两种配置模式
& p# Y, y+ m! A1 V& m6 t
增强版：EPCS4，4Mbit储存量，支持AS和JTAG两种配置模式
/ M8 [' C/ U& R0 s7 M) L O# b3 a6 d
3、8M Byte 高速SDARM
8 h& r& i X0 M, W9 m
一片2M×32Bit SDRAM ，4个Bank，最高166MHz读写速度；
t; Y! X1 ?) e1 K) @! ^: e5 b
4、LVDS扩展接口（DB62接口）
( n& X5 b& m" z9 Y& b
同时提供提供：
; i2 h0 Q$ ]7 `
12路LVDS信号输出；
; p+ A; R+ h" m, a" A% V
12路LVDS信号输入；
n! `2 Y3 _) {+ `: T, a
12路LVTTL信号（输入输出可编程）
6 O' u) D( I" z- ?- Z V6 q
2 L) k: G* c$ _8 Z- w, Q( j( C
5、RedLogic扩展接口（VME48接口）
2 f# j( {, O4 \" I; C8 f
提供32路LVTTL信号，其中包括一路专用时钟输入和一路专用时钟输出.通过相应的扩展板，可以实现Video，Audio和高 速AD/DA等应用。用户也可以开发自己定义的接口板。
7 K1 Y" f: a- A. X8 C8 U
9 _6 B6 C0 p! ~4 x6 J, G0 U" w) ~/ D
【配套软件】
/ `2 f" h( J5 X$ }! f- x
1、 相关开发工具软件
6 x; H; |5 `' U$ U2 c1 _, b6 E
2、 开发实例及文档
9 y& c2 y+ l! N6 g5 {' O
3、 FPGA和ASIC设计资源库
' q* b0 W N X( u# e; C
7 h/ Q( \4 y3 R* ?1 `
【设计文档】
7 O9 q3 X6 S: k) X; ^) C) T
1、开发板用户手册
% z" r7 o ~( R2 J! q
2、开发板原理图和PCB（Protel99SE格式）
5 ]4 Y$ {9 l1 Y2 ?- W. X: ]
3、QuartusII和NIOSII IDE安装指导和入门教程
. l, g, M. @$ z! P2 }) S
4、主要芯片的数据手册和仿真模型（Verilog HDL语言描述）
2 z7 T- e: r/ {* j. p, I( O* v- g$ t5 b
# h0 N6 U! J6 U8 k6 n9 D! A9 [
【开发实例】
+ f- f- ^5 o% g, k
● BASE64解码算法
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Base64编码
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Base64是网络上最常见的用于传输8Bit字节代码的编码方式之一，大家可以查看RFC2045～RFC2049，上面有MIME的详细规范。
- J1 ^- t: X) K. K, T& s4 U
Base64要求把每三个8Bit的字节转换为四个6Bit的字节（3*8 = 4*6 = 24），然后把6Bit再添两位高位0，组成四个8Bit的字节，也就是说，转换后的字符串理论上将要比原来的长1/3。
1 a8 T( P% O4 Y7 q. c
本设计完成了BASE64解码算法的FPGA程序设计和验证。
0 {- _& Z9 `# X* {
/ z" H w& O5 V5 L {; G' ^3 R, Z
● 数据采集卡
5 W6 r9 H( D5 X! L* k) j
FPGA内部产生数据源，主机端程序响应pci卡发出的中断信号，将硬件板卡中的数据传入主机，并将数据在界面上显示相应的数据以及接收到的帧数。将收到的数据存入硬盘，以便查看。
2 C' k! u1 b, K1 q; L+ ]. R3 p
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电话: 010-51299598 62535108-11 FAX：010-62538108-17
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010-82625208 手机:13671276968
4 W& W9 ?: E& M! |' p, L9 B
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